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Linea 13: | Linea 13: | ||
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+ | {{:vlsi:workbook:analog:techniques:gate_cap_testbench.png} | ||
===== Gate capacitance ===== | ===== Gate capacitance ===== | ||
Linea 24: | Linea 26: | ||
Basta simulare un MOS connesso a condensatore, con Vs = Vg = Vb = 0 e variare Vg sul gate | Basta simulare un MOS connesso a condensatore, con Vs = Vg = Vb = 0 e variare Vg sul gate | ||
da -Vdd a +Vdd | da -Vdd a +Vdd | ||
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+ | {{:vlsi:workbook:analog:techniques:gate_cap_testbench.png?600}} | ||
Linea 38: | Linea 43: | ||
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