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| Linea 13: | Linea 13: | ||
| + | |||
| + | {{:vlsi:workbook:analog:techniques:gate_cap_testbench.png} | ||
| ===== Gate capacitance ===== | ===== Gate capacitance ===== | ||
| Linea 24: | Linea 26: | ||
| Basta simulare un MOS connesso a condensatore, con Vs = Vg = Vb = 0 e variare Vg sul gate | Basta simulare un MOS connesso a condensatore, con Vs = Vg = Vb = 0 e variare Vg sul gate | ||
| da -Vdd a +Vdd | da -Vdd a +Vdd | ||
| + | |||
| + | |||
| + | {{:vlsi:workbook:analog:techniques:gate_cap_testbench.png?600}} | ||
| Linea 30: | Linea 35: | ||
| //[[http://www.edaboard.com/thread156795.html]]// \\ | //[[http://www.edaboard.com/thread156795.html]]// \\ | ||
| //[[http://www.el.gunma-u.ac.jp/~kobaweb/news/pdf/e85-c_5_1182.pdf]]// | //[[http://www.el.gunma-u.ac.jp/~kobaweb/news/pdf/e85-c_5_1182.pdf]]// | ||
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