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Linea 4: Linea 4:
 [ __[[vlsi:​workbook2|Back]]__ ] [ __[[vlsi:​workbook2|Back]]__ ]
  
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 +//Synopsys Timing Constraints and Optimization User Guide// ​ \\
 +[[http://​acms.ucsd.edu/​_files/​tcoug.pdf]]
  
 [[http://​www.synopsys.com/​Community/​Interoperability/​Pages/​TapinSDC.aspx]] [[http://​www.synopsys.com/​Community/​Interoperability/​Pages/​TapinSDC.aspx]]
Linea 11: Linea 16:
 [[http://​www.microsemi.com/​document-portal/​doc_download/​131597-design-constraints-guide]] [[http://​www.microsemi.com/​document-portal/​doc_download/​131597-design-constraints-guide]]
  
-[[http://acms.ucsd.edu/_files/tcoug.pdf]]+[[http://application-notes.digchip.com/056/56-39741.pdf]]
  
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