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| + | * **[[vlsi:workbook:digital:cmos_logic|Basic digital CMOS ]]** | ||
| + | * Introduction | ||
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| * **[[vlsi:workbook:digital:hdlsim|Verilog/VHDL simulation]]** | * **[[vlsi:workbook:digital:hdlsim|Verilog/VHDL simulation]]** | ||
| Linea 54: | Linea 61: | ||
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| - | * **[[vlsi:workbook:digital:pnr|Place and route (PNR)]]** | + | * **[[vlsi:workbook:digital:pnr|Automatic place and route (PNR) with Cadence Encounter]]** |
| * Introduction | * Introduction | ||
| * Tools overview | * Tools overview | ||