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| Linea 14: | Linea 14: | ||
| ====== Literature ====== | ====== Literature ====== | ||
| - | IEEE Standards: [[http://standards.ieee.org//downloads/1076/]] | + | IEEE Standards: [[http://standards.ieee.org/downloads/1076/]] |
| * IEEE std. 1076-1987 | * IEEE std. 1076-1987 | ||
| Linea 30: | Linea 30: | ||
| * C.H. Roth, //Digital Systems Design Using VHDL// [x] | * C.H. Roth, //Digital Systems Design Using VHDL// [x] | ||
| * K.C. Chang, //Digital Systems Design With VHDL and Synthesis// [x] | * K.C. Chang, //Digital Systems Design With VHDL and Synthesis// [x] | ||
| + | * B. Mealy and F. Tappero, //Free Range VHDL// [[http://www.freerangefactory.org/]] | ||
| * S. Brown, Z. Vranesic, //Fundamentals of Digital Logic With VHDL Design// [x] | * S. Brown, Z. Vranesic, //Fundamentals of Digital Logic With VHDL Design// [x] | ||
| * P.P. Chu, //RTL Hardware Design Using VHDL// [x] | * P.P. Chu, //RTL Hardware Design Using VHDL// [x] | ||
| + | * F. Vahid and R. Lysecky 2007, //VHDL for Digital Design// | ||
| * HARDI Electronics publisher, //VHDL Handbook// [x] | * HARDI Electronics publisher, //VHDL Handbook// [x] | ||
| Linea 37: | Linea 39: | ||
| ====== Self training and courses (free!) ====== | ====== Self training and courses (free!) ====== | ||
| + | //VHDL Tutorial: Learn by Example// (by by W. Zhang, July 2001) \\ | ||
| + | [[http://esd.cs.ucr.edu/labs/tutorial/]] | ||
| - | YouTube lectures (playlists): | + | [[http://users.ece.gatech.edu/sudha/book/starters-guide/]] |
| + | \\ | ||
| + | YouTube lectures (playlists): | ||
| + | |||
| + | //Digital Design VHDL// (few minutes videos with nice examples!) \\ | ||
| + | http://m.youtube.com/playlist?list=PL7kkolCtIBKLukrBsEDwKRTE64JvaJDhM | ||
| ====== Other online training solutions (priced) ====== | ====== Other online training solutions (priced) ====== | ||
| Linea 51: | Linea 60: | ||
| [[http://www.opencores.org/]] | [[http://www.opencores.org/]] | ||
| - | ======= Lecture notes ====== | + | ======= Lecture notes (Italian) ====== |
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| + | //Introduzione al linguaggio VHDL// \\ | ||
| + | //Aspetti teorici ed esempi di progettazione// (C. Brandolese, Politecnico di Milano) \\ | ||
| + | [[http://www.fabiopanozzo.it/download/Reti_logiche/VHDL%20%28Dispensa%20a%20cura%20di%20Carlo%20Brandolese%29.pdf]] | ||
| + | |||
| + | |||
| + | Corso: //Architetture degli elaboratori - VHDL// (S. Ferrari, Università di Milano) \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/]] | ||
| + | |||
| + | Dispense del corso: \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/disp_VHDL_2006_07.pdf]] | ||
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| + | Slides del corso: \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/lez0_2006_07_lucidi_doppio.pdf]] \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/lez1_2006_07_lucidi_doppio.pdf]] \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/lez2_2006_07_lucidi_doppio.pdf]] \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/lez3_2006_07_lucidi_doppio.pdf]] \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/lez4_2006_07_lucidi_doppio.pdf]] \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/lez5_2006_07_lucidi_doppio.pdf]] \\ | ||
| + | [[http://homes.di.unimi.it/ferrari/ArchReti2006_07/lez6_2006_07_lucidi_doppio.pdf]] | ||
| + | |||
| [[http://www.uniroma2.it/didattica/lai//deposito/]] \\ | [[http://www.uniroma2.it/didattica/lai//deposito/]] \\ | ||
| Linea 67: | Linea 99: | ||
| [[http://www.uniroma2.it/didattica/lai//deposito/VHDL-12.pdf]] \\ | [[http://www.uniroma2.it/didattica/lai//deposito/VHDL-12.pdf]] \\ | ||
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| + | Last update: [[pacher@to.infn.it|Luca Pacher]] - Jun 5, 2014 | ||
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