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| Linea 1: | Linea 1: | ||
| ====== Notes ====== | ====== Notes ====== | ||
| - | ===== Getting started with Verilog and Verilog-A ===== | + | [ __[[elettronica:home|Home]]__ ] |
| - | * [[http://www.asic-world.com/verilog/]] | + | [ __[[vlsi:personalpages:panati|Back]]__ ] |
| - | * [[http://www.asic-world.com/examples/verilog/]] | + | |
| - | * [[http://www2.engr.arizona.edu/~slysecky/resources/verilog_tutorial.html]] | + | |
| - | * [[http://www.google.it/url?sa=t&rct=j&q=&esrc=s&source=web&cd=6&ved=0CGYQFjAF&url=http%3A%2F%2Flyle.smu.edu%2F~lli%2Fcse3381_session14.pdf&ei=U7F3UqHaFcfFtQbipYHgCQ&usg=AFQjCNEYKRF3KIVpodkHN5-fb8G-g138pg&sig2=aUOqh9ETlAwqZ9WRTtIGlA&bvm=bv.55819444,d.Yms&cad=rja|Examples]] | + | |
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| - | ===== Getting started with tcl/tk scripting ===== | + | |